| 网页标题 | 使用Design Compiler、PrimeTime 等工具进行RTL到门级网表的实现，逻辑综合流程及STA分析 |
|---|---|
| 网页关键词 | Design Compiler, PrimeTime ,RTL,逻辑综合, STA,静态时序分析 |
| 网页描述 | 新思科技在线课程讲解如何使用Design Compiler、PrimeTime 等工具进行RTL到门级网表的实现，逻辑综合流程及STA分析 |
| 查询链接 | https://www.synopsys.com/zh-cn/china/events/RTL-synthesis-design-compiler-primetime.html |
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主要关键词出现频率：
| Design | 1次 |
| Compiler | 1次 |
| 3次 | |
| PrimeTime | 1次 |
| RTL | 1次 |
| 逻辑综合 | 1次 |
| STA | 1次 |
| 静态时序分析 | 1次 |
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